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ysdx:要求:1、特别熟悉ZYNQ7020的FPGA开发,至少FPGA8年以上开发经验。2、这两个月有时间。3、要求在北京,方便当面沟通。(本信息有效期:-9.30)有意向的请私信给我。谢谢。
jwuser:本帖最后由jwuser于2024-11-2513:55编辑关于FPGA时钟信号输入要求attach_img
writer38:佬佬,哪里可以去找ASIC流片的原型验证文档啊?
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